PCI-SIG confirma que PCIe 8.0 irá transferir 1 TB/s de dados bidirecionais

O PCI-SIG, consórcio responsável pelo desenvolvimento do padrão PCI Express, confirmou o avanço do PCIe 8.0. A versão 0.3 da especificação já foi disponibilizada aos membros, marcando o primeiro rascunho formal do grupo de trabalho. O cronograma prevê que o padrão seja finalizado em 2028.

A principal evolução é a capacidade de atingir 256 GT/s por linha, o que se traduz em 512 GB/s em cada direção em um slot x16. Isso equivale a 1 TeraByte por segundo de transferência bidirecional, um salto expressivo frente às gerações anteriores.

Reprodução/PCI-SIG

Comparação com versões anteriores

O PCIe 8.0 dobra a velocidade em relação ao PCIe 7.0 e quadruplica a taxa do PCIe 6.0. Para efeito prático, essa evolução amplia as possibilidades de servidores, estações de trabalho avançadas, data centers de inteligência artificial e aplicações de computação de alto desempenho (HPC).

A tabela oficial mostra como o ganho se distribui por número de linhas. Em configurações menores, como x1 e x4, o ganho também é significativo, mas é no formato x16 que a tecnologia atinge todo o potencial de largura de banda.

Evolução do PCI Express

GeraçãoAno de lançamentoTaxa por lane (x1)Largura de banda x16Situação atualPCIe 1.02003250 MB/s4 GB/sObsoleto, presente apenas em sistemas muito antigosPCIe 2.02007500 MB/s8 GB/sAinda visto em PCs antigos, substituído em massaPCIe 3.020101 GB/s16 GB/sAinda comum em muitas máquinas, mas já sendo superadoPCIe 4.020172 GB/s32 GB/sMuito utilizado em SSDs NVMe e placas de vídeo atuaisPCIe 5.020194 GB/s64 GB/sComeça a aparecer em GPUs de última geração e SSDs topo de linhaPCIe 6.020228 GB/s128 GB/sEspecificação finalizada, mas ainda sem placas comerciais amplamente disponíveisPCIe 7.02025 (previsto)16 GB/s256 GB/sEm desenvolvimento, lançamento estimado para meados da décadaPCIe 8.02028 (previsto)32 GB/s1 TB/sEspecificação em rascunho (v0.3), prevista para finalização em 2028

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Prioridades além da velocidade

Como é possível concluir, os responsáveis pela especificação não querem só aumentar a taxa de dados. Há também um esforço para manter compatibilidade retroativa com versões anteriores do PCIe, assim como reduzir consumo energético e aperfeiçoar protocolos de correção de erros.

Graças à dedicação dos grupos de trabalho, estamos desenvolvendo um interconector de alta largura de banda e baixa latência, capaz de impulsionar a próxima geração de tecnologias como IA, redes de alta velocidade, edge computing e até aplicações em computação quântica

Fonte: Adrenaline